Diseño y Evaluaciòn de Arquitecturas de Computadoras / Marta Beltran Pardo

By: Contributor(s): Material type: TextLanguage: esp Publication details: Pearson 2010 Madrid, esDescription: 326 p. , tablasISBN:
  • 9788483226506
Subject(s): DDC classification:
  • 004. 22 B458d
Summary: CONCEPTOS BASICOS DE PROCESADORES; DISEñO DE UN REPERTORIO DE INSTRUCCIONES; DECISIONES ACERCA DEL TIPO DE ALMACENAMIENTO DE OPERANDOS; CONCEPTOS BASICOS DE MEMORIA Y E/S; DISEñO DE UNA JERARQUIA DE MEMORIAS BASICAS; MECANISMO COMPLETO DE ACCESO DE MEMORIA; TECNICAS DE AUMENTO DE PRESTACIONES PARA PROCESADORES; PLANIFICACION DINAMICA DE INSTRUCCIONES; PLANIFICACION DE INSTRUCCION DE ACCESO A MEMORIA; RESUMEN DE DECISIONES DE DISEñO DE TECNICAS DE AUMENTO DE PRESTACIONES PARA PROCESADORES; TECNICAS DE AUMENTO DE PRESTACIONES PARA MEMORIA Y E/S; TECNICAS DE OPTIMIZACION PARA LA MEMORIA CACHE; REDUCCION DE LA PENALIZACION POR FALLO; SISTEMAS MULTIPROCESADOR Y MULTICOMPUTADOR; CLASIFICACION DE ARQUITECTURAS CON VARIOS PROCESADORES; ARQUITECTURA DE MEMORIA COMPARTIDA; EVALUACION DE PRESTACIONES; DEFINICION DE METRICAS DE RENDIMIENTO; METRICAS DE RENDIMIENTO SENCILLAS.
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CONCEPTOS BASICOS DE PROCESADORES; DISEñO DE UN REPERTORIO DE INSTRUCCIONES; DECISIONES ACERCA DEL TIPO DE ALMACENAMIENTO DE OPERANDOS; CONCEPTOS BASICOS DE MEMORIA Y E/S; DISEñO DE UNA JERARQUIA DE MEMORIAS BASICAS; MECANISMO COMPLETO DE ACCESO DE MEMORIA; TECNICAS DE AUMENTO DE PRESTACIONES PARA PROCESADORES; PLANIFICACION DINAMICA DE INSTRUCCIONES; PLANIFICACION DE INSTRUCCION DE ACCESO A MEMORIA; RESUMEN DE DECISIONES DE DISEñO DE TECNICAS DE AUMENTO DE PRESTACIONES PARA PROCESADORES; TECNICAS DE AUMENTO DE PRESTACIONES PARA MEMORIA Y E/S; TECNICAS DE OPTIMIZACION PARA LA MEMORIA CACHE; REDUCCION DE LA PENALIZACION POR FALLO; SISTEMAS MULTIPROCESADOR Y MULTICOMPUTADOR; CLASIFICACION DE ARQUITECTURAS CON VARIOS PROCESADORES; ARQUITECTURA DE MEMORIA COMPARTIDA; EVALUACION DE PRESTACIONES; DEFINICION DE METRICAS DE RENDIMIENTO; METRICAS DE RENDIMIENTO SENCILLAS.